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AD9528BCPZ是一款雙級PLL，集成JESD204B/JESD204C SYSREF發(fā)生器，可用于多器件同步。其技術參數如下：

PLL：帶旁路

輸入：CMOS，HSTL，LVDS

輸出：HSTL，LVDS

電路數：1

比率 - 輸入:輸出：2：14

差分 - 輸入:輸出：是/是

頻率 - 最大值：1.25GHz

分頻器/倍頻器：是/無

電壓 - 供電：3.135V ~ 3.465V

工作溫度：-40°C ~ 85°C

安裝類型：表面貼裝型

器件封裝：72-LFCSP-VQ（10x10）

第一級鎖相環(huán)(PLL) (PLL1)通過減少系統時鐘的抖動，從而實現輸入基準電壓調理。第二級PLL (PLL2)提供高頻時鐘，可實現來自時鐘輸出驅動器的較低積分抖動以及較低寬帶噪聲。外部VCXO提供PLL2所需的低噪聲基準電壓，以滿足苛刻的相位噪聲和抖動要求，實現可以接受的性能。片內VCO的調諧頻率范圍為3.450 GHz至4.025 GHz。集成的SYSREF發(fā)生器輸出單次、N次或連續(xù)信號，并與PLL1和PLL2輸出同步，以便對齊多個器件的時間。

AD9528BCPZ可產生最高頻率為1.25 GHz的六路輸出（輸出0至輸出3、輸出12和輸出13），以及最大頻率高達1 GHz的八路輸出。

應用場景

高性能無線收發(fā)器

LTE和多載波GSM基站

無線和寬帶基礎設施

醫(yī)療儀器

為高速ADC、DAC、DDS、DDC、DUC、MxFE提供時鐘；支持JESD204B/JESD204C

低抖動、低相位噪聲時鐘分配

自動測試設備(ATE)和高性能儀器儀表

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